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第1题
异步电平时序逻辑电路的存储电路一般是由触发器组成的。
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第2题
时序逻辑电路按照触发器时钟的连接方式不同,可以分为同步时序逻辑电路和()两大类。
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第3题
以触发器状态作为电路输出的同步时序逻辑电路属于Mealy型电路。
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第4题
在设计同步时序逻辑电路时,实现相同功能,使用D触发器的电路一定比使用JK触发器的电路简单。
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第5题
时序逻辑电路主要由组合逻辑电路和反馈环节构成。
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第6题
在同步时序逻辑电路中,电路状态是由任意触发器组成的存储电路来保存的。
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第7题
指出下列哪种电路结构的触发器可以构成移位寄存器,哪些不能构成移位寄存器。如果能够,请在()内画√,否则画×。 (A)RS锁存器() (B)同步RS触发器() (C)主从JK触发器() (D)维持阻塞触发器() (E)用CMOS传输门组成的边沿触发器()
A.×、√、√、√、×
B.×、√、×、√、√
C.×、√、√、×、√
D.√、√、√、√
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第8题
脉冲异步时序逻辑电路的存储电路由()组成,电路输入信号为()。
A.触发器;脉冲信号
B.延迟元件;电平信号
C.触发器;电平信号
D.延迟元件;脉冲信号
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第9题
门电路的延时时间是产生组合逻辑电路竞争与冒险的唯一原因。
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第10题
没有空翻现象的触发器有 。
A.主从RS触发器
B.维持阻塞RS触发器
C.维持阻塞D触发器
D.传输延迟JK边沿触发器
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