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MAXPLUSSII中编译VHDL源程序时，要求（)。

A.文件名和实体可不同名

B.文件名和实体名无关

C.文件名和实体名要相同

D.不确定

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第1题

Quartus2中编译VHDL源程序时要求文件名和实体名要相同。

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第2题

Quartus2中编译VHDL源程序时要求文件名和实体名要相同

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第3题

MAXPLUSII中编译VHDL源程序时要求（)。

A.文件名和实体可不同名

B.文件名和实体名无关

C.文件名和实体名要相同

D.不确定

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第4题

QuartusII中编译VHDL源程序时要求（)。

A.文件名和实体可以不同名

B.文件名和实体名无关

C.文件名和实体名要相同

D.不确定

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第5题

VHDL源程序的文件名应与()相同，否则无法通过编译。

VHDL源程序的文件名应与（)相同，否则无法通过编译。

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第6题

VHDL文本编辑中编译时出现如下的报错信息：Error: VHDL syntax error: signal declaration must have ‘；’，but found begin instead. 其错误原因是（）

A.错将设计文件存入了根目录，并将其设定成工程

B.信号声明缺少分号

C.设计文件的文件名与实体名不一致

D.程序中缺少关键词

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第7题

VHDL文本编辑中编译时出现如下的报错信息 Error:VHDL Design File “mux21” must contain an entity of the same name，其错误原因是

A.错将设计文件的后缀写成.tdf 而非

B.错将设计文件存入了根目录，并将其设定成工程

C.设计文件的文件名与实体名不一致

D.程序中缺少关键词

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第8题

VHDL文本编辑中编译时出现如下的报错信息Error: VHDL syntax error: choice value 1ength mus

A.表达式宽度不匹配

B.错将设计文件存入了根目录，并将其设定成工程

C.设计文件的文件名与实体名不一致

D.程序中缺少关键词

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第9题

VHDL文本编辑中编译时出现如下的报错信息Error: VHDL syntax error: signa1 declaration must

A.其错误原因是()。

B.信号声明缺少分号

C.错将设计文件存入了根目录，并将其设定成工程

D.设计文件的文件名与实体名不一致

E.程序中缺少关键词

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第10题

11、VHDL文本编辑中编译时出现如下的报错信息 Error: Can’t open VHDL “WORK”，其错误原因是（）。

A.错将设计文件的后缀写成.tdf，而非.vhd

B.错将设计文件存入了根目录，并将其设定成工程

C.设计文件的文件名与实体名不一致

D.程序中缺少关键词

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