题目
Pentium微处理器执行存储器读周期时,在时钟周期T1期间必须使
(Address Data Strobe)和
信号处于什么状态?
A.0,0
B.0和1
C.1,0
D.1,1
第1题
Pentium微处理器执行突发式存储器读总线周期时,Cache(Cache Enable)和W/R信号的状态应该是______。
A) 1,1
B) 1,0
C) 0,1
D) 0,0
第2题
下面是是关于Pentium 微处理器总线时序的叙述,其中错误的是
A.CPU通过总线接口部件完成一次存储器读/写I/0所需要的时间称为总线周期
B.Pentium微处器执行流水线式总线周期时,下一个总线周期使用的地址在前一个总线周期传送数据时提供
C.Pentium微处器的基本总线周期需要2个或2个以上的总线时钟周期
D.Pentium 微处理器的突发式读总线周期由2-1-1-1个时钟周期组成, 共传递5个64位数据
第4题
Pentium微处理器进行存储器读操作时,在时钟周期T1期间,完成下列操作()。
A.W/R信号变为高电平
B.发送存储器地址
C.读操作码
D.读操作数
第6题
Pentium微处理器进行存储器读操作时,在时钟周期T(XB)期间,完成下列哪一项操作?()
A.W/R信号变为高电平
B.发送存储器地址
C.读操作码
D.读操作数
第7题
Pentium微处理器进行存储器读操作时,在时钟周期T1期间,完成下列______操作。
A.信号变为高电平
B.发送存储器地址
C.读操作码
D.读操作数
第8题
Pentium微处理器进行存储器读操作时,在时钟周期T1期间,完成下列哪一项操作?()
A.W/R信号变为高电平
B.发送存储器地址
C.读操作码
D.读操作数
第10题
Pentium 微处理器的突发式存储器读/写总线周期包含()CPU时钟周期。
A.2个
B.3个
C.4个
D.5个
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