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[单选题]

让8253的定时器/计数器0工作于方式3,产生方波输出。设CLK的时钟频率为1MHz,为了得到1KHz的方波,则时间常数的值应为(计数值为BCD码格式)__________。

A.1100H

B.1000H

C.03E8H

D.0100H

答案
D、0100H
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第1题

以下程序中,clk_50M为50MHz输入时钟,则clk为多少Hz的方波?() always@(posedge clk_50M) begin if (cnt == 24999999) begin clk2_hz = 1'b1; cnt = 0; end else begin cnt = cnt + 1; clk2_hz = 1'b0; end end always@(posedge clk2_hz) clk =~ clk;

A.1

B.2

C.4

D.8

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第2题

当用指示灯观察计数器输出时,CP时钟的频率应为下面哪一种?

A.1KHz

B.10KHz

C.1Hz

D.5KHz

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第3题

ADC0809芯片的CLK端不能使用的频率的方波输入()。

A.10KHZ

B.100KHZ

C.500KHZ

D.5MHz

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第4题

用显示译码器驱动七段显示器观测二位二进制计数器输出变化情况,时钟信号频率可以是

A.1Hz

B.500Hz

C.1kHz

D.2kHz

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第5题

视频中用定时器0产生半周期10毫秒的方波,TH0=?请用16进制回答两个十六进制数码字,A~F大写,以便电脑自动批阅
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第6题

频率为1000Hz的周期性方波,经过截止频率为1000Hz的理想低通滤波器后的输出为2000Hz的正弦波。
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第7题

在以下程序中,Clk_50M为频率为50MHz的系统时钟,则下列说法中正确的有 reg Clk; reg [31:0] Cnt; always@(posedge Clk_50M or negedge Rst) begin if(!Rst) begin Cnt <= 1; Clk <= 1; end else begin if(Cnt >= 25000000) begin Cnt <= 1; Clk <= ~Clk; end else Cnt<= Cnt + 1; end end

A.该模块为同步复位

B.该模块的功能是分频器

C.若系统时钟频率为50MHz,则输出Clk的频率为2MHz

D.该程序为时序逻辑电路

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第8题

根据程序描述的逻辑功能,下列说法正确的有 module Learn7_2(clk,clr,Q); input clk,clr; output[3:0] Q; reg[3:0] Q always @(negedge clk or negedge clr) begin if (!clr) Q <= 3’b0000 else begin Q <= (Q >> 1) Q[3] <= ~Q [2]&&~Q [1]&&~Q [0] end end endmodule

A.扭环型计数器,有效输出状态为8个

B.环型计数器,有效输出状态为4个

C.能够自启动

D.不能自启动

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第9题

已知时钟信号clk的频率为50MHz,下列程序的逻辑功能为()。 always @(posedge clk or negedge nreset) begin if(!nreset) begin per_count = 0; clk0 = 0; end else begin if(per_count<6250000) per_count=per_count+1; else begin per_count = 0; clk0=!clk0; end end end

A.8Hz分频器

B.4Hz分频器

C.移位寄存器型计数器

D.循环译码器

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第10题

8254端口地址为40H~43H,CH0作为计数器,计数时钟频率1MHZ,下列程序执行后,输出脉冲的宽度是 s MOV   AL,36H OUT   43H,AL MOV   AX,20000 OUT    40H,AL MOV   AL,AH OUT   40H,AL
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