更多“在时钟脉冲CP信号为高电平期间,因输入信号变化而引起触发器状态变化多于一次的现象,称为 。”相关的问题
第1题
如果在时钟脉冲CP =1期间,由于干扰的原因,使触发器的数据输入信号经常有变化,此时不能选用TTL主从型结构的触发器,而应该选用边沿型或维持阻塞结构的触发器。对吗?
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第2题
边沿触发器的次态仅取决于CP信号的边沿到达时输入的逻辑状态,而在这时刻之前或以后,输入信号的变化对触发器输出的状态没有影响。
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第3题
脉冲异步时序逻辑电路的存储电路由()组成,电路输入信号为()。
A.触发器;脉冲信号
B.延迟元件;电平信号
C.触发器;电平信号
D.延迟元件;脉冲信号
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第4题
下列存在一次变化现象的触发器是 。
A.主从JK触发器
B.基本RS触发器
C.同步D触发器
D.负边沿JK触发器
E.主从D触发器
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第5题
杆件截面骤然变化(或几何外形局部不规则)而引起的局部应力骤增现象,称为()
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第6题
边沿JK触发器在输入J=K=1时,如果CP信号的频率为32 kHz,则Q端输出脉冲的频率为16 kHz。
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第7题
维持阻塞RS触发器利用 , 在时钟CP的边沿传递数据, 传输延迟D触发器利用 , 在时钟CP的边沿传递数据。 (A)门的延时 (B)维持阻塞线 (C)脉冲的低电平 (D)高电平或低电平
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第8题
在组合逻辑电路中,当输入信号改变状态时,输出端可能出现瞬间干扰窄脉冲的现象称为 。
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第9题
JK触发器在JK输入信号的作用下可以工作在4个状态——置1,置0,保持和翻转。
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第10题
工质(或系统)的状态参数不随时间而变化的状态称为平衡状态。
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